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CDCM1804 1:3 LVPECL时钟缓冲器+附加LVCMOS输出和可编程分频器数据表
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2024-08-21
姬房有
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CDCM1804时钟驱动器将一对差分时钟输入分配给三对LV pecl差分时钟输出Y[2:0]和Y[2:0]，时钟分配具有最小偏斜。CDCM1804专门设计用于驱动50-2传输线。另外。CDCM1804提供单端LVCMOS输出Y3。该输出在三个LVPECL输出级上延迟1.6 ns，以将信号转换期间的噪声影响降至最低。
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