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基于FPGA和DSP的高速图像处理系统
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2017-10-19
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图像处理系统主要由 ＣＭＯＳ图像传感器（ＭＴ９Ｍ０１１）、
ＦＰＧＡ（ＥＰ１Ｃ１２Ｑ２４０Ｃ８）、双 口 ＲＡＭ（ＣＹ７Ｃ０２５）、ＤＳＰ（ＴＭ３２０ＶＣ５５０２）、视频 Ｄ／Ａ（ＡＤＶ７１２３）和一些存储器
等组成［３－４］，如 图１所 示。首 先，在图像采集模块控制
ＣＯＭＳ图像传感器 下，图 像 数 据 则 以２５ｆ／ｓ的 速 率 向
ＦＰＧＡ 输送。然 后，通 过 ＦＰＧＡ 的 控 制 使 其 缓 存 在 片
外的ＳＤＲＡＭ 中，之后实时显示模块控制 ＡＤＶ７１２３做
到了对图像的实时显示。如果用户通过外部控制，选择
了压缩模式，则原始的图像数据将由帧存模块移至高速
缓冲模块中，ＤＳＰ通过 ＥＭＩＦ接口外扩存储器的方式，
高效的读取双口 ＲＡＭ 中的图像数据。最后，图像数据
在 ＤＳＰ内部做好ＪＰＥＧ 压缩后，以相同 的 方 式 通 过 高
速缓冲模块，把数据传给 ＦＰＧＡ 的存储控制模块，做到
压缩图像数据的存储。
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