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基于FPGA的IP碎片重组模块
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2010-07-26
笑尽往事
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为了更好地支持网络安全，IP碎片重组是IDS/IPS中一个必不可少的操作。由于采用软件实现IP碎片重组的速度很低，很难达到高速接口的线速处理要求，所以在高速IDS/IPS上应采用硬件处理的机制。本文实现了一个基于Altera FPGA的IP碎片重组模块，可解决IDS/IPS处理IP碎片重组遇到的性能瓶颈问题，同时提供了一种IP碎片攻击的预警机制，其特点是可以根据设备资源的使用情况，提供不同程度的警报信息。借助于QuatusII综合布线工具，经面向硬件电路的仿真验证，本文的方法可实现OC-48接口（2.5Gb/s）上线速分组的IP碎片重组，并具有硬件开销小，可扩展性好的特点。
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