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AVS自适应环路滤波器硬件设计

消耗积分:0 | 格式:rar | 大小:256 KB | 2011-06-28

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设计了一种适合于AVS的自适应环路滤波器，由于计算复杂度高的特点，采用并行加流水的方法实现自适应环路滤波的硬件设计，达到了实时解码的要求。采用Verilog语言进行设计、仿真，通过FPGA -*证。用0.18p,mCMOS工艺库综合，电路规模为3万门左右，最高频率能够达到140MHz，可实时解码720p/1080i高清AVS码流。
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