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如何用简单的RC网络降低可调低压差稳压器(LDO)的输出噪声

消耗积分:0 | 格式:pdf | 大小:593.87KB | 2023-11-29

王斌

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　　噪声对高性能模拟电路设计人员来说是一个极其重要的参数。对高速时钟、模数转换器 (ADC)、数模转换器 (DAC)、电压控制振荡器(VCO)和锁相环(PLL)来说尤其如此。降低输出电压噪声的关键是保持交流闭环增益接近单位增益，且不影响交流性能和直流闭环增益。

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