Verilog HDL程序设计例程

消耗积分:0 | 格式:pdf | 大小:111 KB | 2011-09-07

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【例 3.1】4 位全加器
module adder4(cout,sum,ina,inb,cin);
output[3:0] sum;
output cout;
input[3:0] ina,inb;
input cin;
assign {cout,sum}=ina+inb+cin;
endmodule

Verilog HDL

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chenmalloc 2012-06-18 0 回复举报 好书收起回复

1039795567 2012-05-27 0 回复举报 好东西啊收起回复

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