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CDCVF2509 3.3V锁相环时钟驱动器数据表

消耗积分:0 | 格式:pdf | 大小:1.06MB | 2024-08-22

李麒铭

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CDCVF2509 是一款高性能、低偏差、低抖动锁相环 (PLL) 时钟驱动器。该器件使用 PLL 根据时钟 (CLK) 输入信号对反馈 (FBOUT) 输出的频率和相位进行精准 校准。该器件专门设计用于同步 DRAM。CDCVF2509 在 3.3V VCC 电压下工作，并提供专为驱动点对点负载 而设计的集成串联阻尼电阻器。 一组五个输出和一组四个输出提供九个低偏差、低抖动 的 CLK 副本。输出信号占空比调整为 50%，与 CLK 处的占空比无关。每组输出可通过控制（1G 和 2G） 输入单独启用或禁用。当 G 输入为高电平时，输出随 CLK 进行相位和频率切换。当 G 输入为低电平时，输 出被禁用为逻辑低电平状态。
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