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LMK1D210x低附加抖动LVDS缓冲器数据表

消耗积分:0 | 格式:pdf | 大小:1.75MB | 2024-08-20

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LMK1D210x 时钟缓冲器将两个时钟输入（IN0 和 IN1）分配给总共多达 8 对差分 LVDS 时钟输出 （OUT0、OUT7），通过超小偏斜实现时钟分配每个 缓冲器块由一个输入和最多 4 个 LVDS 输出组成。输 入可以为 LVDS 、 LVPECL 、 HCSL 、 CML 或 LVCMOS。 LMK1D210x 专为驱动 50Ω 传输线路而设计。在以单 端模式驱动输入的情况下，必须将图 9-6 中所示的适当 偏置电压施加到未使用的负输入引脚。
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