非阻塞赋值

示例编号	Example-4-1
相关章节	第4章4.3.1小节
教学目标	非阻塞赋值的基本语法
补充说明	对于时序逻辑，即always模块的敏感表为沿敏感信号（多为时钟或复位的正沿或负沿），统一使用非阻塞赋值“<=”

阻塞赋值

示例编号	Example-4-2
相关章节	第4章4.3.1小节
教学目标	阻塞赋值的基本语法
补充说明	对于always模块的敏感表为电平敏感信号的组合逻辑，统一使用阻塞赋值“=”

连续赋值

示例编号	Example-4-3
相关章节	第4章4.3.1小节
教学目标	连续赋值的基本语法
补充说明	对于assign关键字描述的组合逻辑（通常称之为连续赋值语句），统一使用“=”，变量被定义为wire型信号

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