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LMK04832-SP符合JESD204B标准的航天级、超低噪声、双环路时钟抖动清除器数据表
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2024-08-20
王雪
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LMK04832-SP 是支持 JEDEC JESD204B 的高性能时 钟调节器，适用于航天应用。 PLL2 可以配置 14 个时钟输出以驱动 7 个 JESD204B 转换器或其他逻辑器件（使用器件和 SYSREF 时 钟）。SYSREF 可以通过直流和交流耦合提供。14 个 输出中的每一个输出都可以单独配置为用于传统计时系 统的高性能输出（不限于 JESD204B 应用）。 LMK04832-SP 可以配置在双 PLL、单 PLL 或时钟分 配模式下工作（使用或不使用 SYSREF 生成或重新计 时）。PLL2 可以使用内部或外部 VCO 工作。 高性能与多种特性（如功耗和性能权衡调节、双 VCO、动态数字延迟和保持）相结合，使 LMK04832- SP 能够提供灵活的高性能时钟树。 LMK04832-SP 采用 10.9mm × 10.9mm、64 引脚 CFP 封装。
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